Ingénierie électrique vhdl

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Je suis un étudiant en EE et je peux écrire des programmes [au moins simples] dans plus de langues que je n'ai de doigts. Je viens de commencer à apprendre le VHDL et je me demandais quel serait un bon projet pour vraiment connaître la langue et les outils pertinents? …

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Quelle est la différence entre les tests et la vérification?

Chaque manuel que j'ai vu fait une grande partie du fait que le test et la vérification sont deux concepts différents. Pourtant, aucun d'eux ne fait une distinction claire (ou assez claire pour moi, enfin). Pour fournir un peu de contexte, je m'intéresse à la vérification des conceptions de matériel …

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VHDL: dénomination et interprétation de l'architecture

Remarque: J'utilise l'ISE de Xilinx et j'ai une carte FPGA avec laquelle travailler (avec des commutateurs et des lumières, etc.), et j'ai piraté ensemble quelques projets simples jusqu'à présent. En même temps, je lis plusieurs tutoriels pour jeter les bases de ce que je fais. J'ai vu diverses entités et …

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Comment fonctionnent les transistors BJT dans un état saturé?

Voici ce que je sais des BJT NPN (Transistors de jonction bipolaires): Le courant de base-émetteur est multiplié par le temps HFE au niveau du collecteur-émetteur, de sorte que Ice = Ibe * HFE Vbeest la tension entre la base-émetteur et, comme toute diode, se situe généralement autour de 0,65V. …

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Qu'est-ce qui me ferait choisir Verilog ou VHDL plutôt que la conception schématique sur CPLD ou FPGA?

Je n'ai absolument aucune expérience en logique programmable, j'utilise principalement des microcontrôleurs dans mes projets mais récemment, je devais travailler avec la vidéo et le microcontrôleur est tout simplement trop lent pour ce dont j'avais besoin, alors j'ai commencé à jouer avec des CPLD. J'ai pu obtenir de bons résultats …

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Comment diviser 50 MHz à 2 Hz en VHDL sur Xilinx FPGA

J'ai une carte FPGA Xilinx, avec un cristal 50 MHz. Je dois diviser cela à 2 Hz en VHDL. Comment puis-je faire cela?

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Conception du firmware FPGA: quelle taille est trop grande?

J'ai une transformation de traitement du signal particulièrement importante qui doit être transférée de matlab vers VHDL. Cela nécessite certainement une sorte de partage des ressources. Un peu de calcul m'a donné ce qui suit: 512 pieds de 64 points 41210 opérations de multiplication-ajout Étant donné que le plus grand …

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Carte de développement FPGA bon marché [fermé]

Fermé. Cette question est hors sujet . Il n'accepte pas actuellement les réponses. Voulez-vous améliorer cette question? Mettez à jour la question afin qu'elle soit sur le sujet pour Electrical Engineering Stack Exchange. Fermé il y a 4 ans . Je veux commencer par FPGA, mais je n'ai jamais travaillé …

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recommandations de livre sur FPGA [fermé]

Fermé. Cette question est hors sujet . Il n'accepte pas actuellement les réponses. Voulez-vous améliorer cette question? Mettez à jour la question afin qu'elle soit sur le sujet pour Electrical Engineering Stack Exchange. Fermé il y a 2 ans . Quels titres de livres recommanderiez-vous pour commencer avec les FPGA …

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Comment déboguer les signaux rouges dans ModelSIM?

Je dois concevoir une machine à états utilisant uniquement des portes NAND pour la partie combinatoire et des bascules D pour la logique séquentielle. Tout devrait fonctionner à une horloge de 1 GHz / 53. Maintenant, avant de m'agresser avec "nous ne ferons pas vos devoirs pour vous", permettez-moi de …

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Comment puis-je spécifier des signaux «peu importe» en VHDL?

Dans les cours de conception logique, nous avons tous appris qu'il était possible de minimiser une fonction logique, par exemple en utilisant une carte de Karnaugh ou l' algorithme Quine – McCluskey . Nous avons également appris que les valeurs "Don't Care" augmentent le potentiel de minimisation. Par exemple, prenez …

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Comment identifier les zones d'une conception FPGA qui utilisent le plus de ressources et d'espace?

Je travaille sur une grande conception FPGA, et je suis très proche des limites de ressources du FPGA que j'utilise actuellement, le Xilinx LX16 dans le package CSG225. La conception est également presque terminée, mais pour le moment, elle ne rentrera plus dans le FPGA. Je peux désactiver les pièces …

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Différence entre l'instruction If-else et Case dans VHDL

Je veux comprendre comment différentes constructions en code VHDL sont synthétisées en RTL. Quelqu'un peut-il me dire la différence entre la construction If-Else et les constructions d' instructions Case d'un processus en VHDL en termes de la façon dont le code est inféré dans le circuit RTL par l'outil de …

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Quand est-il plus approprié d'utiliser des représentations VECTOR vs INTEGER?

Dans le fil de commentaires sur une réponse à cette question: Sorties incorrectes dans l'entité VHDL, il a été déclaré: "Avec des entiers, vous n'avez pas le contrôle ou l'accès à la représentation logique interne dans le FPGA, tandis que SLV vous permet de faire des trucs comme l'utilisation efficace …

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Utilisez-vous VHDL de nos jours?

Je suis un étudiant en génie électrique et j'étudie le langage de description du matériel appelé VHDL. Je l'ai cherché sur Google à la recherche d'un IDE (je suis sur un mac), mais cette langue semble assez morte. Voici donc ma question: dans mon futur métier d'ingénieur électricien, le VHDL …

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