Ingénierie électrique verilog

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VHDL et Verilog sont les HDL du jour. Quels sont les avantages de l'un ou l'autre pour quelqu'un qui n'a aucune expérience des HDL?

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En quoi la conception des ASIC est-elle différente de la synthèse FPGA HDL?

J'ai quelques expériences avec les suites d'outils FPGA / HDL telles que Xilinx ISE, Lattice Diamond, etc. Le flux de travail général consiste à écrire Verilog / VHDL, à simuler, à tester et à programmer le FPGA. J'ai entendu quelques personnes dire que la conception des ASIC était très différente. …

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Une conception FPGA peut-elle être principalement (ou complètement) asynchrone?

Nous avons eu un très court cours FPGA / Verilog à l'université (il y a 5 ans) et nous avons toujours utilisé des horloges partout. Je commence à nouveau avec les FPGA comme passe-temps, et je ne peux m'empêcher de m'interroger sur ces horloges. Sont-ils absolument nécessaires, ou une conception …

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Implémentations lisibles et pédagogiques d'un processeur dans un HDL

Pouvez-vous recommander une implémentation lisible et pédagogique d’un processeur en VHDL ou Verilog? De préférence, quelque chose de bien documenté. PS Je sais que je peux regarder opencores, mais je m'intéresse particulièrement aux choses que les gens ont réellement examinées et trouvées intéressantes. PS2. Désolé pour les tags insipides, mais …

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IDE gratuit pour VHDL et Verilog [fermé]

Fermé. Cette question est hors sujet . Il n'accepte pas actuellement de réponses. Voulez-vous améliorer cette question? Mettez à jour la question afin qu'elle soit sur le sujet pour Electrical Engineering Stack Exchange. Fermé il y a 5 ans . Je suis intéressé à apprendre le VHDL et Verilog. Je …

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Comment apprendre le HDL

J'ai un cours de design numérique au cours de ce semestre et j'adore ça. Maintenant, je sais que la plupart des travaux sur les systèmes embarqués et la conception numérique sont d'abord effectués sur des simulateurs informatiques, puis mis en œuvre à l'aide de matériels. Je me demandais donc comment …

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Techniques de délimitation / synchronisation de protocole série

Comme la communication série asynchrone est largement répandue parmi les appareils électroniques, même de nos jours, je pense que beaucoup d'entre nous ont rencontré une telle question de temps en temps. Considérez un appareil électronique Det un ordinateur PCconnecté à une ligne série (RS-232 ou similaire) et requis pour échanger …

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Pourquoi les verrous présumés sont-ils mauvais?

Mon compilateur se plaint des verrous inférés dans mes boucles combinatoires ( always @(*), dans Verilog). On m'a également dit que les verrous présumés devraient de préférence être évités. Qu'est-ce qui ne va pas exactement avec les verrous déduits? Ils facilitent certainement l'écriture des boucles combinatoires.

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Quelle est la différence entre les tests et la vérification?

Chaque manuel que j'ai vu fait une grande partie du fait que le test et la vérification sont deux concepts différents. Pourtant, aucun d'eux ne fait une distinction claire (ou assez claire pour moi, enfin). Pour fournir un peu de contexte, je m'intéresse à la vérification des conceptions de matériel …

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Différence entre affectation bloquante et non bloquante Verilog

Je lisais cette page http://www.asic-world.com/verilog/verilog_one_day3.html lorsque je suis tombé sur ce qui suit: Nous devons normalement réinitialiser les bascules, donc chaque fois que l'horloge passe de 0 à 1 (posedge), nous vérifions si la réinitialisation est affirmée (réinitialisation synchrone), puis nous continuons avec une logique normale. Si nous regardons attentivement, …

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Quel est cet opérateur appelé "+:" dans verilog

Je passe par le cas de test verilog et j'ai trouvé une déclaration assign XYZ = PQR_AR[44*8 +: 64]; Que signifie l'opérateur "+:"? J'ai essayé de trouver cela sur Google, mais je n'ai pas obtenu de réponse pertinente.

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Comment fonctionnent les transistors BJT dans un état saturé?

Voici ce que je sais des BJT NPN (Transistors de jonction bipolaires): Le courant de base-émetteur est multiplié par le temps HFE au niveau du collecteur-émetteur, de sorte que Ice = Ibe * HFE Vbeest la tension entre la base-émetteur et, comme toute diode, se situe généralement autour de 0,65V. …

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Qu'est-ce qui me ferait choisir Verilog ou VHDL plutôt que la conception schématique sur CPLD ou FPGA?

Je n'ai absolument aucune expérience en logique programmable, j'utilise principalement des microcontrôleurs dans mes projets mais récemment, je devais travailler avec la vidéo et le microcontrôleur est tout simplement trop lent pour ce dont j'avais besoin, alors j'ai commencé à jouer avec des CPLD. J'ai pu obtenir de bons résultats …

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Verilog: XOR tous les signaux du vecteur ensemble

Disons qu'on me donne un vecteur wire large_bus[63:0]de largeur 64. Comment puis-je XOR les signaux individuels ensemble sans les écrire tous: assign XOR_value = large_bus[0] ^ large_bus[1] ^ ... ^ large_bus[63] ? Je suis particulièrement intéressé à le faire pour les vecteurs où la largeur est spécifiée par a localparam.

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Quelle est la motivation de l'utilisation de Verilog ou VHDL sur C?

Je viens d'un milieu de programmation et je ne me suis pas trop occupé du matériel ou du firmware (tout au plus un peu électronique et Arduino). Quelle est la motivation à utiliser des langages de description matérielle (HDL) tels que Verilog et VHDL sur des langages de programmation comme …

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