Ingénierie électrique synthesis

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Je suis un peu confus si je dois utiliser des entiers en VHDL pour les signaux de synthèse et les ports, etc. J'utilise std_logic dans les ports de haut niveau, mais à l' intérieur , je me sers tous les entiers parcouraient de l'endroit. Cependant, je suis tombé sur quelques …

17 vhdl synthesis

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Pourquoi l'équipement numérique a-t-il plus de latence que l'analogue?

L'explication est-elle que l'équipement numérique met plus de temps à se propager? Par exemple, une synthèse logicielle est très lente par rapport à une synthèse matérielle.

14 analog software hardware synthesis synthesizer

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Comment puis-je spécifier des signaux «peu importe» en VHDL?

Dans les cours de conception logique, nous avons tous appris qu'il était possible de minimiser une fonction logique, par exemple en utilisant une carte de Karnaugh ou l' algorithme Quine – McCluskey . Nous avons également appris que les valeurs "Don't Care" augmentent le potentiel de minimisation. Par exemple, prenez …

11 vhdl synthesis optimization

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Outils de synthèse Verilog gratuits et génériques?

Existe-t-il des outils de synthèse gratuits ou open source qui peuvent convertir Verilog RTL en une netlist de porte générique? (composé de NAND génériques, NOR, XOR, D-flops / registres, etc. Optimisation non requise.). Si ce n'est pas pour la langue complète, que diriez-vous d'un sous-ensemble "utile" de RTL (au-delà d'une …

10 verilog synthesis

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Comment une variable VHDL est-elle synthétisée par des outils de synthèse

Je connais deux façons dont une variable VHDL est synthétisée par un outil de synthèse: Variable synthétisée en logique combinatoire Variable synthétisée comme un verrou involontairement (lorsqu'une variable non initialisée est affectée à un signal ou à une autre variable) Quelles sont les autres façons de synthétiser une variable VHDL? …

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Comment obtenir une conception FPGA qui fonctionnera certainement sur du matériel réel

Je viens de commencer à apprendre la conception de la logique numérique avec les FPGA et j'ai construit de nombreux projets. La plupart du temps (puisque je suis une sorte de noob), j'ai un design qui simule parfaitement (simulation comportementale) mais ne synthétise pas correctement. Donc, ma question est "quelles …

9 digital-logic fpga design xilinx synthesis

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