Ingénierie électrique vhdl

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VHDL et Verilog sont les HDL du jour. Quels sont les avantages de l'un ou l'autre pour quelqu'un qui n'a aucune expérience des HDL?

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En quoi la conception des ASIC est-elle différente de la synthèse FPGA HDL?

J'ai quelques expériences avec les suites d'outils FPGA / HDL telles que Xilinx ISE, Lattice Diamond, etc. Le flux de travail général consiste à écrire Verilog / VHDL, à simuler, à tester et à programmer le FPGA. J'ai entendu quelques personnes dire que la conception des ASIC était très différente. …

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Implémentations lisibles et pédagogiques d'un processeur dans un HDL

Pouvez-vous recommander une implémentation lisible et pédagogique d’un processeur en VHDL ou Verilog? De préférence, quelque chose de bien documenté. PS Je sais que je peux regarder opencores, mais je m'intéresse particulièrement aux choses que les gens ont réellement examinées et trouvées intéressantes. PS2. Désolé pour les tags insipides, mais …

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IDE gratuit pour VHDL et Verilog [fermé]

Fermé. Cette question est hors sujet . Il n'accepte pas actuellement de réponses. Voulez-vous améliorer cette question? Mettez à jour la question afin qu'elle soit sur le sujet pour Electrical Engineering Stack Exchange. Fermé il y a 5 ans . Je suis intéressé à apprendre le VHDL et Verilog. Je …

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VHDL: conversion d'un type INTEGER en un STD_LOGIC_VECTOR

J'ai construit un compteur mod-16, et le résultat de sortie est un INTEGER (tous les exemples que j'ai vus utilisaient INTEGER). J'ai construit un décodeur d'affichage hexadécimal à 7 segments, et son entrée est un STD_LOGIC_VECTOR (écrit de cette façon car il était facile de cartographier la table de vérité). …

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Kit de développement FPGA le plus abordable pour apprendre la théorie VHDL et FPGA?

Verrouillé . Cette question et ses réponses sont verrouillées car la question est hors sujet mais a une signification historique. Il n'accepte pas actuellement de nouvelles réponses ou interactions. Je cherche quelque chose avec lequel je peux jouer sans trop dépenser. Je ne suis pas éligible à un rabais académique, …

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VHDL: composant vs entité

Je me demande quelle est la différence entre la composante d'une entité. Je voudrais savoir dans quels cas il vaut mieux utiliser des composants plutôt que des entités. Merci beaucoup.

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Question d'entrevue VHDL - détecter si un nombre peut être divisé par 5 sans reste

J'ai vu une belle question d'entrevue pour VHDL - construire un système qui reçoit un nombre et détecte s'il peut être divisé par 5 sans reste. J'ai essayé de résoudre cela avec une machine d'état (je suppose qu'ils ne veulent pas que vous utilisiez mod ou rem ) et même …

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std_logic ou std_ulogic?

Il semble que le monde ait décidé que std_logic(et std_logic_vector) sont la façon par défaut de représenter les bits en VHDL. L'alternative serait std_ulogic, qui n'est pas résolue. Cela me surprend car généralement, vous ne décrivez pas un bus , vous ne voulez donc pas plusieurs pilotes et vous n'avez …

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Comment apprendre le HDL

J'ai un cours de design numérique au cours de ce semestre et j'adore ça. Maintenant, je sais que la plupart des travaux sur les systèmes embarqués et la conception numérique sont d'abord effectués sur des simulateurs informatiques, puis mis en œuvre à l'aide de matériels. Je me demandais donc comment …

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VHDL qui peut endommager le FPGA

J'ai lu quelque part qu'un mauvais code VHDL pouvait endommager le FPGA. Est-il même possible d'endommager un FPGA avec du code VHDL? Quel genre de conditions provoquerait cela et quels sont les pires scénarios?

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IDE VHDL pour un environnement GNU / linux

Je dois étudier VHDL à partir de 0 et j'aimerais avoir une option qui fonctionne sous un noyau linux au lieu de NT / Windows: des conseils? Je peux aussi vraiment apprécier de bons liens vers de bonnes ressources VHDL pour un débutant, merci.

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Vérification du processeur logiciel

Je suis actuellement en train de concevoir un CPU simple en VHDL en utilisant Xilinx ISE et ISIM. La partie conception se déroule remarquablement bien, mais je n'arrive pas à trouver un moyen de faire une vérification de manière cohérente. En ce moment, j'ai un banc de test VHDL que …

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Des environnements Mac OS X natifs pour commencer avec les VHDL / FPGA?

Le titre résume assez bien ma question: existe-t-il des environnements natifs Mac OS X pour commencer avec les VHDL / FPGA?

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VHDL: des entiers pour la synthèse?

Je suis un peu confus si je dois utiliser des entiers en VHDL pour les signaux de synthèse et les ports, etc. J'utilise std_logic dans les ports de haut niveau, mais à l' intérieur , je me sers tous les entiers parcouraient de l'endroit. Cependant, je suis tombé sur quelques …

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