Questions marquées «verilog»

Verilog est un langage de description de matériel (HDL) utilisé pour modéliser des systèmes électroniques. Il est le plus couramment utilisé dans la conception, la vérification et la mise en œuvre de puces logiques numériques. Veuillez également indiquer [fpga], [asic] ou [verification] selon le cas. Les réponses à de nombreuses questions Verilog sont spécifiques à une cible.



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Détecter les registres non réinitialisés
Lors de l'écriture de Verilog, j'utilise une variété de "linters" qui donneront des erreurs et des avertissements. Ce sont mon simulateur (ModelSim), mon compilateur (Quartus II), ainsi qu'un linter (Verilator). Ensemble, j'ai une bonne couverture pour les pièges courants, tels que les décalages de taille de bus et les verrous …
8 fpga  verilog 


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